數(shù)字信號的預(yù)加重(Pre-emphasis)

如前所述，很多常用的電路板材料或者電纜在高頻時都會呈現(xiàn)出高損耗的特性。目前的高速串行總線速度不斷提升，使得流行的電路板材料達到極限從而對信號有較大的損耗，這可能導(dǎo)致接收端的信號極其惡劣以至于無法正確還原和解碼信號，從而出現(xiàn)傳輸誤碼。如果我們觀察高速的數(shù)字信號經(jīng)過長的傳輸通道傳輸后到達接收端的眼圖，它可能是閉合的或者接近閉合的。因此工程師可以有兩種選擇：一種是在設(shè)計中使用較為昂貴的電路板材料；另一種是仍然沿用現(xiàn)有材料，但采用某種技術(shù)來補償傳輸通道的損耗影響?？紤]到在高速率的情況下低損耗的電路板材料和電纜的成本過高，我們通常會優(yōu)先嘗試相應(yīng)的信號補償技術(shù)，預(yù)加重(Pre-emphasis)和均衡就是高速數(shù)字電路中常用的兩種信號補償技術(shù)。
數(shù)字信號的眼圖分析（Eye Diagram Analysis）;山東數(shù)字信號測試哪里買

這種方法由于不需要單獨的時鐘走線，各對差分線可以采用各自的CDR電路，所以對各對線的等長要求不太嚴(yán)格(即使要求嚴(yán)格也很容易實現(xiàn)，因為走線數(shù)量減少，而且信號都是點對點傳輸)。為了把時鐘信息嵌在數(shù)據(jù)流里，需要對數(shù)據(jù)進行編碼，比較常用的編碼方式有ANSI的8b/10b編碼、64b/66b編碼、曼徹斯特編碼、特殊的數(shù)據(jù)編碼以及對數(shù)據(jù)進行加擾等。

嵌入式時鐘結(jié)構(gòu)的關(guān)鍵在于CDR電路，CDR的工作原理如圖1.17所示。CDR通常用一個PLL電路實現(xiàn)，可以從數(shù)據(jù)中提取時鐘。PLL電路通過鑒相器(PhaseDetector)比較輸入信號和本地VCO(壓控振蕩器)間的相差，并把相差信息通過環(huán)路濾波器(Filter)濾波后轉(zhuǎn)換成低頻的對VCO的控制電壓信號，通過不斷的比較和調(diào)整終實現(xiàn)本地VCO對輸入信號的時鐘鎖定。 浙江數(shù)字信號測試故障模擬信號和數(shù)字信號之間的區(qū)別嗎？

時域數(shù)字信號轉(zhuǎn)換得到的頻域信號如果起來，則可以復(fù)現(xiàn)原來的時域信號。

描繪了直流頻率分量加上基頻頻率分量與直流頻域分量加上基頻和3倍頻頻率分量，以及5倍頻率分量成的時域信號之間的差別，我們可以看到不同頻域分量的所造成的時域信號邊沿的差別。頻域里包含的頻域分量越多，這些頻域分量成的時域信號越接近 真實的數(shù)字信號，高頻諧波分量主要影響信號邊沿時間，低頻的分量影響幅度。當(dāng)然，如果 時域數(shù)字信號轉(zhuǎn)變岀的一個個頻率點的正弦波都疊加起來，則可以完全復(fù)現(xiàn)原來的時域 數(shù)字信號。其中復(fù)原信號的不連續(xù)點的震蕩被稱為吉布斯震蕩現(xiàn)象。

這種并/串轉(zhuǎn)換方法由于不涉及信號的編解碼，結(jié)構(gòu)簡單，效率較高，但是需要收發(fā)端進行精確的時鐘同步以控制信號的復(fù)用和解復(fù)用操作，因此需要專門的時鐘傳輸通道，而且串行信號上一旦出現(xiàn)比較大的抖動就會造成串/并轉(zhuǎn)換的錯誤。

因此，這種簡單的并/串轉(zhuǎn)換方式一般用于比較關(guān)注傳輸效率的芯片間的短距離互連或者一些光端機信號的傳輸中。另外，由于信號沒有經(jīng)過任何編碼，信號中可能會出現(xiàn)比較長的連續(xù)的0或者連續(xù)的1,因此信號必須采用直流耦合方式，收發(fā)端一旦存在比較大的共?；虻卦肼暎瑫?yán)重影響信號質(zhì)量，因此這種并/串轉(zhuǎn)換方式用于電信號傳輸時或者傳輸速率不太高(通常<1Gbps),或者傳輸距離不太遠(通常<50cm)的場合。 模擬信號和數(shù)字信號的相互轉(zhuǎn)換；

我們經(jīng)常使用到的總線根據(jù)數(shù)據(jù)傳輸方式的不同，可以分為并行總線和串行總線。

并行總線是數(shù)字電路中早也是普遍采用的總線結(jié)構(gòu)。在這種總線上，數(shù)據(jù)線、地址線、控制線等都是并行傳輸，比如要傳輸8位的數(shù)據(jù)寬度，就需要8根數(shù)據(jù)信號線同時傳輸；如果要傳輸32位的數(shù)據(jù)寬度，就需要32根數(shù)據(jù)信號線同時傳輸。除了數(shù)據(jù)線以外，如果要尋址比較大的地址空間，還需要很多根地址線的組合來不同的地址空間。圖1.7是一個典型的微處理器的并行總線的工作時序，其中包含了1根時鐘線、16根數(shù)據(jù)線、16根地址線以及一些讀寫控制信號。 數(shù)字信號帶寬用每bit占用的時間間隔的倒數(shù)來近似表示，傳輸速率的單位是bit/s，傳輸速率=傳輸信號的帶寬。云南自動化數(shù)字信號測試

數(shù)字設(shè)備是由很多電路組成來實現(xiàn)一定的功能，系統(tǒng)中的各個部分通過數(shù)字信號的傳輸來進行信息和數(shù)據(jù)的交互。山東數(shù)字信號測試哪里買

為了提高串行數(shù)據(jù)傳輸?shù)目煽啃?，現(xiàn)在很多更高速率的數(shù)字接口采用對數(shù)據(jù)進行編碼后再做并/串轉(zhuǎn)換的方式。編碼的方式有很多，如8b/9b編碼、8b/10b編碼、64b/66b編碼、128b/130b編碼等，下面以當(dāng)下流行的ANSI8b/10b編碼為例進行介紹。

在ANSI8b/10b編碼方式中，8bit的數(shù)據(jù)先通過相應(yīng)的編碼規(guī)則轉(zhuǎn)換成10bit的數(shù)據(jù)，再進行并/串轉(zhuǎn)換；接收端收到信號后先把串行數(shù)據(jù)進行串/并轉(zhuǎn)換得到10bit的數(shù)據(jù)，再通過10bit到8bit的解碼得到原始傳輸?shù)?bit數(shù)據(jù)。因此，如果發(fā)送端并行側(cè)的數(shù)據(jù)速率是8bit×100Mbps,通過8b/10b編碼和并/串轉(zhuǎn)換后的串行側(cè)的數(shù)據(jù)速率就是1bit×1Gbps。8b/10b編碼方法早由IBM發(fā)明，后來成為ANSI標(biāo)準(zhǔn)的一部分(ANSIX3.230-1994,clause11),并在通信和計算機總線上廣泛應(yīng)用。表1.1是ANSI8b/10b編碼表的一部分，以數(shù)據(jù)0x00為例， 山東數(shù)字信號測試哪里買

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